资讯
Altera发布其Stratix 10 FPGA和SoC体系结构和产品细节(2015-06-09)
和SoC能够受益于成熟可靠的性能增强设计方法,例如寄存器重新定时、流水线和其他设计优化方法。这些设计方法在传统的FPGA体系结构中是不可能实现的。HyperFlex体系......
利用强大的软件设计工具为FPGA开发者赋能(2024-07-17)
们能够专注于FPGA处理器系统的创新和优化。”仍然是不变的核心设计理念。
例如,具有拖放IP实例化和“构建即正确”的设计方法,大大增强了易用性;通过图形化设计界面的易用性,辅之以命令行工具的快捷性,能够......
利用强大的软件设计工具为FPGA开发者赋能(2024-07-17)
软硬件设计人员的体验,使他们能够专注于FPGA处理器系统的创新和优化。”仍然是不变的核心设计理念。
例如,具有拖放IP实例化和“构建即正确”的设计方法,大大增强了易用性;通过图形化设计界面的易用性,辅之......
利用强大的软件设计工具为FPGA开发者赋能(2024-07-19 09:27)
软硬件设计人员的体验,使他们能够专注于FPGA处理器系统的创新和优化。”仍然是不变的核心设计理念。例如,具有拖放IP实例化和“构建即正确”的设计方法,大大增强了易用性;通过图形化设计界面的易用性,辅之......
Achronix帮助用户基于Speedcore eFPGA IP来构建Chiplet(2023-08-22)
含其应用所需的特定功能,从而实现更低的功耗和成本
• 可对chiplet和ASIC之间的接口进行优化,以最小的延迟来获得最大带宽
• 基于面积优化的eFPGA IP chiplet具有更小的封装尺寸
基于Speedcore......
Achronix帮助用户基于Speedcore eFPGA IP来构建Chipl(2023-08-22)
,以最小的延迟来获得最大带宽
● 基于面积优化的eFPGA IP chiplet具有更小的封装尺寸
基于Speedcore eFPGA IP的chiplet比单片集成eFPGA和ASIC具有......
Achronix帮助用户基于Speedcore eFPGA IP来构建Chiplet(2023-08-22)
之间的接口进行优化,以最小的延迟来获得最大带宽
基于面积优化的eFPGA IP chiplet具有更小的封装尺寸
基于Speedcore eFPGA IP的chiplet比单片集成eFPGA和......
Achronix帮助用户基于Speedcore eFPGA IP来构建Chiplet(2023-08-22 15:12)
,以最小的延迟来获得最大带宽• 基于面积优化的eFPGA IP chiplet具有更小的封装尺寸基于Speedcore eFPGA IP的chiplet比单片集成eFPGA和ASIC具有......
易灵思正式宣布易构加速平台新方案的全面可用性(2020-10-14)
所需的内核IP授权。”
易构方案是建基在与合作伙伴的定制产品过程中所获得的丰富经验之上。它的目标是将 Quantum 技术的功耗、性能和面积优势提供给饱受空间和散热所限的边缘计算应用。通过......
Synopsys发布其专为支持多种处理器内核的优化实现而设计的套件(2013-06-25)
计可达到的功耗、性能和面积是有巨大影响的。” VeriSilicon负责设计方法和项目管理的公司副总裁李念峰说。“当我们考虑对一个优化的实现有利的所有因素时,DesignWare Duet嵌入......
IAR Embedded Workbench 将支持 RISC-V 太空级处理器 NOEL-V(2022-12-22)
了从高性能支持 Linux 架构到面积优化的微控制器解决方案等配置。不仅如此,NOEL-V 设计还包含容错功能,自动纠正由于太空环境中天然存在的辐射而产生的故障,使其能够正常地运行软件,
IAR......
IAR Embedded Workbench 将支持 RISC-V 太空级处理器(2022-12-19)
个实现 架构的处理器的可综合 VHDL 模型。该模型可高度配置,提供了从高性能支持 Linux 架构到面积优化的微控制器解决方案等配置。不仅如此, 设计还包含容错功能,自动......
IAR Embedded Workbench 将支持 RISC-V 太空级处理器 NOEL-V(2022-12-19)
了从高性能支持 Linux 架构到面积优化的微控制器解决方案等配置。不仅如此,NOEL-V 设计还包含容错功能,自动纠正由于太空环境中天然存在的辐射而产生的故障,使其能够正常地运行软件,
IAR Embedded......
以工艺窗口建模探索路径:使用虚拟制造评估先进DRAM电容器图形化的工艺窗口(2023-11-20)
图形化方案,并对其工艺灵敏性和工艺窗口进行了比较。我们为每个图形化方案 (SADP和SAQP) 建立了虚拟工艺流程(如图1),并将电容器孔面积作为电容及其均匀性分析的衡量标准。为了算出孔面积......
【直播|大咖分享】离职华为创办“加速云”,Eric带你探索FPGA在人工智能的应用(2017-01-13)
展趋势
2.FPGA在人工智能中的应用
FPGA在人工智能中中的优势、应用场景及应用案例
3.基于FPGA 的深度学习实现的优化
基于FPGA的深度学习实现的设计要素及优化方法......
能提升的前提下,带来显著的面积优化、功耗和成本的降低
针对 4D 成像雷达工作负载,新增的雷达加速器功能可提供高度可编程的硬件解决方案,显著提升性能
专为多传感器汽车、无人机、机器......
Cadence 扩充 Tensilica Vision 产品线,新增毫米波雷达加速器及针对汽车应用优化的新款 DSP(2024-03-05 16:08)
能提升的前提下,带来显著的面积优化、功耗和成本的降低• 针对 4D 成像雷达工作负载,新增的雷达加速器功能可提供高度可编程的硬件解决方案,显著提升性能• 专为多传感器汽车、无人机、机器......
Cadence扩充Tensilica Vision产品线,新增毫米波雷达加速器及(2024-03-05)
Cadence扩充Tensilica Vision产品线,新增毫米波雷达加速器及;本文引用地址:内容提要
● 单个 用于嵌入式视觉、雷达、激光雷达和 AI 处理,在性能提升的前提下,带来显著的面积优化......
IAR Embedded Workbench 将支持 RISC-V 太空级处理器 NOEL-V(2022-12-23)
太空级处理器。
NOEL-V 是一个实现 RISC-V 架构的处理器的可综合 VHDL 模型。该模型可高度配置,提供了从高性能支持 Linux 架构到面积优化的微控制器解决方案等配置。不仅......
IAR Embedded Workbench 将支持 RISC-V 太空级处理器 NOEL-V(2022-12-19 10:48)
太空级处理器。NOEL-V 是一个实现 RISC-V 架构的处理器的可综合 VHDL 模型。该模型可高度配置,提供了从高性能支持 Linux 架构到面积优化的微控制器解决方案等配置。不仅如此,NOEL......
性能翻倍,AMD推出首款大规模数据处理市场的加速卡产品Alveo V80(2024-06-06)
它外部芯片,便可帮助用户实现性能最大化,减少功耗、占板面积以及时延。
众所周知,采用HBM比DDR而言,更为昂贵。但是如果能够正确地配置FPGA资源作为补充的话,最终就能实现高性价比的竞争优势。而......
异步感应和永磁同步电机这两种有什么优缺点呢?(2023-09-07)
了电机在前后轴有限空间内的布置问题。
蔚来汽车电机总成技术特点:
高度集成(一体集成电机E-Motor、齿轮箱Gearbox和逆变器PEU电机控制器)
异步感应交流电机体积优化
逆变器体积优化
↑蔚来......
赛灵思器件上的 INT4 优化卷积神经网络(2)(2020-09-15)
之一。一种是逐计算元地输出 8 位。另一种是对下一卷积输出 4 位。通过算法优化,两种量化方法都能量化成 2k 步长。差别在于输出数据的位宽以及它们是否是有符号数据。 DSP 强化......
卓胜微:3D堆叠封装正在验证导入(2024-09-10)
卓胜微:3D堆叠封装正在验证导入;近日,卓胜微在投资者平台透露称,公司正在建设高端先进模组技术能力,通过3D堆叠封装形式实现更好的性能和面积优势,产品已经进入验证阶段。
卓胜微表示,为满......
Altera推出的电源优化FPGA参考设计简化了基于FPGA的系统开发(2013-10-22)
Altera推出的电源优化FPGA参考设计简化了基于FPGA的系统开发;Altera今天发布四款新参考设计,这些设计采用了通过收购Enpirion®而获得的电源技术。参考设计为FPGA用户......
eFPGA逐渐成为主流,SoC又有新玩法(2016-11-02)
能稍逊。 FPGA可以通过编程内部逻辑模块来实现各种功能,而且一旦FPGA设计完成后其可实现的最大逻辑规模就确定了。从另一个角度来说,无论FPGA逻辑资源利用率如何,其芯片面积(成本)已经无法改变了。换句话说,不管......
基于动力学仿真的电驱减速箱NVH性能优化方案(2023-01-30)
案设计如下:加强输出轴承径向支撑,如图9所示,增加中间轴承轴向支撑,如图10所示。
3.2 优化方案仿真结果
辐射噪声由壳体表面振动引起,近场声压与壳体有效振动面积上的振动烈度强相关。共振频率下,初始方案与优化方......
Chiplet和异构集成强力支撑SiP市场未来五年年均复合增长率达 8.1%(2023-11-29)
行业不断要求更高的集成度以实现更小外形尺寸和更高性能的产品,SiP 技术趋势依然强劲。在移动和消费市场,由于空间有限,因此非常需要占地面积优化——这对于智能手机、可穿戴设备和其他设备来说是有效的。例如......
中国石化获得“存储器、基于氢利用最大化的氢网优化方法、装置和设备”发明专利(2024-07-03 09:42)
中国石化获得“存储器、基于氢利用最大化的氢网优化方法、装置和设备”发明专利;企查查数据显示,中国石化获得一项发明专利授权,专利名为 " 存储器、基于氢利用最大化的氢网优化方法、装置和设备 ",专利......
为国内设计公司开发基于本地FPGA的验证与设计平台。
明了设计需求
半导体IP核提供商支持复杂的ASIC项目,其中一些项目在时钟速度、片芯面积占用、功耗、可靠性、功能......
从MPS产品规划看电源模块为什么越来越受欢迎?(2022-12-16 14:28)
箱即用的电源模块可以减少多达70%的开发周期,从18周减少到5周。 此外,电源模块相比于分立方案,其还具有小体积,高散热等特点。比如MPS的电源模块中,采用了3D堆叠方法,将电感和IC立体封装,这样可以减少平铺面积......
从MPS产品规划看电源模块为什么越来越受欢迎?(2022-12-16)
从MPS产品规划看电源模块为什么越来越受欢迎?;在绝大部分行业中,模块化由于其方便使用,价格合理,性能优化等特点,已经得到了市场的普遍认可,电源行业也是如此。从工业时代的砖式电源开始,模块......
Codasip 700系列正式问世,赋能定制计算!(2023-10-27)
近的一篇文章中,来自Codasip的战略与生态副总Mike Eftimakis也充分解释了为什么没有放之四海而皆准的处理器优化方法?以及Codasip Studio在通过剖析为每个用例实现不同水平的优化方......
Codasip 700系列正式问世,赋能定制计算!(2023-10-27)
力。在最近的一篇文章中,来自Codasip的战略与生态副总Mike Eftimakis也充分解释了为什么没有放之四海而皆准的处理器优化方法?以及Codasip Studio在通过剖析为每个用例实现不同水平的优化方......
Codasip 700系列正式问世,赋能定制计算!(2023-10-27)
。
Codasip Studio是定制计算解决方案中的一个关键要素,它充分释放了RISC-V处理器IP的潜力。在最近的一篇文章中,来自Codasip的战略与生态副总Mike Eftimakis也充分解释了为什么没有放之四海而皆准的处理器优化方法......
预计2028年MicroLED晶片产值将达4.89亿美元,重点关注AR与车用需求(2024-12-06 17:17:35)
键应用,但仍处于导入与验证阶段,尚无法贡献实际产值。
从技术层面分析,在Micro
LED大型显示的无缝拼接上,短期的方法是改以不同的驱动设计方案提高背板的生产良率,借此优化......
数字芯片设计验证经验分享:将ASIC IP核移植到FPGA上——需求和详细规划以完成充满挑任务(2024-07-26)
开发商合作,共同为国内数字芯片设计公司开发基于本地FPGA的验证与设计平台。
明了设计需求
半导体IP核提供商支持复杂的ASIC项目,其中一些项目在时钟速度、片芯面积占用、功耗、可靠性、功能......
自动驾驶中建图定位的线性优化问题解析(2023-05-06)
的环境观测 。。 上面部分,我们构建了两个时刻间的优化问题,并可以用各种优化策略取去求解。但相比于滤波方法,这并没有什么优越性,其精度和效率都是等价的。
优化方法真正的优势在于它可以考虑更多时刻的信息,从而......
数字芯片设计验证经验分享:将ASIC IP核移植到FPGA上——明了需求和详细规划以完成充满挑战的任务(2024-07-26 10:32)
产品生命周期的早期阶段就执行测试。从产品规格的创建到ASIC模块设计的流片,时间窗口在整个时间轴上都朝着项目开始的方向移动。同样,在设计过程中使用FPGA早已被确立为一种标准方法,以便能够在可提供ASIC......
英诺达再发低功耗EDA工具,将持续在该领域发力(2023-04-25)
估算精度往往不够精确。到了设计流程后期,特别是物理实现之后,功耗的估算会更精确,但此时可采用的功耗优化方法与优化的程度都比较有限。
IC设计流程与低功耗设计
英诺达此次推出的EDA工具GPA是针......
不涨价的FPGA来了!(2024-11-20 14:02:54)
护航未来
近年来,全球半导体供应链屡受挑战,芯片短缺问题一度对行业产生深远影响。易灵思通过优化供应链管理、强化产能规划,确保客户的FPGA需求......
美高森美发布高性能 SmartFusion2 SoC FPGA双轴电机控制套件(2015-05-11)
控制解决方案的灵活设计平台,涵盖紧凑、标准和优质交流驱动和定制步进/伺服电机应用。
美高森美FPGA/SoC高级营销总监Shakeel Peera表示:“SmartFusion2 SoC FPGA双轴电机控制套件采用模块化方法......
是德科技联合新思科技、Ansys 为台积电 N6RF+ 制程节点提供射频设计迁移流程(2024-05-13)
了一个高效、集成的射频电路再设计解决方案
集众多优异解决方案于一身的开放平台可加快从现有 N16 制程无源射频器件向先进 N6RF+ 技术节点的迁移,实现更好的功耗、性能和面积优势
是德......
英特尔的百花齐放与独尊儒术(2023-01-15)
成本和运维成本折中平衡的结果。而商业化方案的成功则离不开向应用的深度优化,即所谓垂直整合,宋继强认为,在超异构计算中,垂直整合比单一技术创新难度高很多,原因有三:
首先,垂直......
341 DSP将视觉、雷达、激光雷达和AI处理功能整合到单个DSP中,适用于多模态、基于传感器的系统设计,能以更小的面积实现最佳能效。当与针对4D成像雷达应用且经过优化的新款Cadence......
CEVA推出功能最强大、低功耗32位DSP架构框架CEVA-TeakLite-4(2012-05-23)
架构可从不到100K门的超低功耗的面积优化实施方案扩展到适用于高端SoC的28nm工艺下主频1.5GHz的方案。所有CEVA-TeakLite-4 DSP采用了支持动态时钟和电压调节的CEVA第二......
3毫秒完成IO配置支持PCIe 2.0的这款低功耗FPGA还有什么特点?(2023-01-07)
第一颗可以同时支持PCIe与GigaE的小面积FPGA”;其次,IO(输入输出口)密度高,与前代相比,这一款单位面积IO数量翻倍,非常适合边缘应用中设备小体积但多IO的场景;第三,IO速度......
莱迪思推出业界首款集成USB的小型嵌入式视觉FPGA(2023-09-27)
思半导体产品营销副总裁Dan Mansur表示:“降低功耗、降低总拥有成本(TCO)和设计尺寸对于扩大人工智能和视觉应用的潜力至关重要。莱迪思CrossLinkU-NX FPGA经过优化,通过将我们领先的低功耗、小尺......
莱迪思推出业界首款集成USB的小型嵌入式视觉FPGA(2023-09-27 14:31)
降低分立式PHY组件所需的总拥有成本和面积o 减少USB设备控制器所需的FPGA逻辑资源§ 低功耗待机模式,始终在线(AON)o 延长电池寿命并简化系统热管理o 优化典型嵌入式视觉应用的功耗§ 完整......
自动环绕相机校准在自动驾驶汽车道路的应用(2023-08-24)
自动环绕相机校准在自动驾驶汽车道路的应用;本文介绍了一种用于道路场景中鲁棒的自动多摄像头校准和修正的方法。该方法利用了从粗糙到精细的随机搜索策略,可以解决初始外部参数的较大扰动,并弥补了非线性优化方法......
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1995,02:获得(TUV)认证福清1996,09:福清厂获得ISO-9002认证.1997:福清厂获得最佳外商投资绩优奖1997,03:深圳宝安厂成立1998:福清厂获得最佳外商投资积优
;北京流歌科技有限公司;;本公司专注于开发高阶FPGA 板卡、FPGA项目、嵌入式软硬件平台等。在FPGA高速板卡、系统电路研发及IP核测试验证等方面、科技科技有着独特的技术优势。目前
些控制应用方面CPLD通常比FPGA速度快,但其提供的逻辑资源较少。Xilinx可编程逻辑解决方案缩短了电子设备制造商开发产品的时间并加快了产品面市的速度,从而减小了制造商的风险。与采用传统方法
;德州艾富莱空调设备有限责任公司销售部;;山东德州艾富莱空调营销服务中心隶属德州艾富莱空调设备有限公司管理,本着服务于客户,在工程设计、选型、报价、工程优化方面真正实现一站式服务;为提
;吉林紫晶电子有限公司市场部;;紫晶公司的现代化厂区面积达44000平方米,其中4200平方米的高洁净化度生产车间全部采用垂直层流式净化方式。公司引进具有九十年代国际先进水平的韩国全自动LCD生产
配置、结构调整、功能整合,致力于为企业提供完整的、适应企业发展需要的IT资源优化方案。助力企业充分运用IT资源,充分享受IT资源优化给企业业务发展带来的结构性优势。 公司成立伊始,即从
冶金、石化、电力、水利、机械、船舶、制药、建材、市政、通讯、医院、汽车制造以及国防工业等国民经济的各个领域提供电能质量改善方面最优化的解决方案和工程总包服务。在电能质量优化方面,嘉臣
;贵州保林自动控制科技有限公司;;贵州保林自动控制科技有限公司致力于自动化设备、系统集成以及国内外众多品牌的代理销售工作及产品配套。长期切实以“品质,服务,创新,科技”为宗旨,为客户提供最新产品资源信息及产品配套优化方