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特性
- 灵活的可重新配置通用平台设计
- 4 个DAC 和 4 个ADC（4D4A）
- 支持单频段、双频段和多频段
- 数据路径和 DSP 模块可完全绕过
- 1、2、3 和 4 的 DAC 与 ADC 采样率之比
- 具有多芯片同步功能的片内 PLL
- 片外 PLL 的外部 RFCLK 输入选项
- 最大 DAC 采样率高达 12 GSPS
- 使用 JESD204C 的最大数据速率高达 12 GSPS
- 可用的模拟带宽高达 8 GHz
- 最大 ADC 采样率高达 4 GSPS
- 使用 JESD204C 的最大数据速率高达 4 GSPS
- 7.5 GHz 模拟输入全功率带宽 (-3 dB)
- 4 GSPS，输入为 -2.7 GHz 时，ADC 交流性能为 -1 dBFS
- 满量程输入电压：1.4 V p-p
- 噪声密度：−147.5 dBFS/Hz
- 噪声指数：26.8 dB
- HD2:−67 dBFS
- HD3：−73 dBFS
- 最差的其他情况（HD2 和 HD3 除外）：2.7 GHz 时，为 −79 dBFS
- 12 GSPS 时的 DAC 交流性能
- 满量程输出电流范围：6.43 mA 至 37.75 mA
- 双信号音 IMD3（每个音调 −7 dBFS）：−78.9 dBc
- 3.7 GHz 时，NSD，单信号音：−155.1 dBc/Hz
- 3.7 GHz 时，SFDR，单信号音：−70 dBc
- SERDES JESD204B/JESD204C 接口，16 个通道，速率高达 24.75 Gbps
- 8 通道 JESD204B/C 变送器 (JTx) 和 8 通道 JESD204B/C 接收器 Rx (JRx)
- JESD204B 与最大 15.5 Gbps 的通道速率兼容
- JESD204C 与最大 24.75 Gbps 的通道速率兼容
- 支持实数或复数数字数据（8、12、16 或 24 位）
- 多种数字特性
- 可配置或可旁路的 DDC 和 DUC
- 8 个细调复数 DUC 和 4 个粗调复数 DUC
- 8 个细调复数 DDC 和 4 个粗调复数 DDC
- 每个 DUC 或 DDC 48 位 NCO
- 可编程 192 抽头 PFIR 滤波器，用于接收均衡
- 支持通过 GPIO 加载的 4 种不同的配置文件设置
- 每个数据路径的可编程延迟
- 接收 AGC 支持
- 用于快速 AGC 控制，具有低延迟的快速检测
- 用于缓慢 AGC 控制的信号监控器
- 发射 DPD 支持
- 细调 DUC 通道增益控制和延迟调整
- DPD 观察路径的粗调 DDC 延迟调整
- 辅助特性
- 快速跳频和直接数字频率合成器(DDS)
- 低延迟环回模式（接收数据路径数据可以路由到发送数据路径）
- 具有可选分频比的 ADC 时钟驱动器
- 功率放大器下游保护电路
- 片内温度监控单元
- 灵活的 GPIO 引脚
- TDD 省电选项和共享 ADC
- 15毫米××15毫米、324 球 BGA，间距 0.8 毫米
AD9081 混合信号前端（MxFE ® ）是一款高度集成的套件，具有四个 16 位、12 GSPS 最大采样率、RF 数模转换器（DAC）内核，以及四个 12 位、4 GSPS 速率、RF 模数转换器（ADC）内核。AD9081 非常适合需要宽带 ADC 和 DAC 来处理具有宽瞬时带宽信号的应用。该套件具有八个发送和八个接收通道，支持 24.75 Gbps/通道 JESD204C 或 15.5 Gbps/通道 JESD204B 标准。该套件还具有片内时钟乘法器，以及直接针对 RF 应用的宽带或多频带数字信号处理（DSP）功能。可以绕过 DSP 数据路径，以允许转换器内核与 JESD204 数据收发器端口之间直接连接。该套件还具有针对相位阵列雷达系统和电子战应用的低延迟回送和跳频模式。提供两种型号的 AD9081。4D4AC 模型支持完整的瞬时通道带宽，而 4D4AB 模型通过自动配置 DSP，来限制启动时的瞬时带宽，从而支持每通道 600 MHz 的最大瞬时带宽。
应用
- 无线通信基础设施
- 微波点对点、E 频段和 5G 毫米波
- 宽带通信系统
- DOCSIS 3.1 和 4.0 CMTS
- 相控阵雷达与电子战
- 电子测试和测量系统
FPGA 互操作性报告 5
3rd Party Solutions 1
器件驱动器 2
产品选型指南 1
模拟对话 3
ADI 始终高度重视提供符合最高质量和可靠性水平的产品。我们通过将质量和可靠性检查纳入产品和工艺设计的各个范围以及制造过程来实现这一目标。出货产品的“零缺陷”始终是我们的目标。查看我们的 质量和可靠性计划和认证 以了解更多信息。
| 产品型号 | 引脚/封装图-中文版 | 文档 | CAD 符号，脚注和 3D模型 |
|---|---|---|---|
| AD9081BBPZ-4D4AB |
324-Ball BGA_ED (15mm x 15mm x 1.58mm)
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| AD9081BBPZ-4D4AC |
324-Ball BGA_ED (15mm x 15mm x 1.58mm)
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| AD9081BBPZRL-4D4AB |
324-Ball BGA_ED (15mm x 15mm x 1.58mm)
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| AD9081BBPZRL-4D4AC |
324-Ball BGA_ED (15mm x 15mm x 1.58mm)
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器件驱动器
API Device Drivers
Device Application Programming Interface (API) C code drivers provided as reference code that allows the user to quickly configure the product using high-level function calls. The library acts as an abstraction layer between the application and the hardware. The API is developed in C99 to ensure agnostic processor and operating system integration. Customers can port this application layer code to their embedded systems by integrating their platform-specific code base to the API HAL layer.
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| 部分模型 | 产品周期 | 描述 | ||
|---|---|---|---|---|
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µModule降压稳压器 1 |
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推荐新设计使用 |
40V IN 、3.5A/6A 降压型超低噪声开关稳压器 μModule 稳压器 |
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超低噪声稳压器 1 |
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推荐新设计使用 |
40VIN、2A Silent Switcher µModule 稳压器 |
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多个输出降压调节器 3 |
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推荐新设计使用 |
三输出 10A 降压型 DC/DC μModule 稳压器 |
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具有可配置4A输出阵列的四通道DC/DC μModule（电源模块）稳压器 |
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推荐新设计使用 |
每通道 8A 输出的双通道、低 V IN DC/DC µModule 稳压器 |
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集成VCO的锁相环 1 |
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推荐新设计使用 |
带集成 VCO 的微波宽带频率合成器 |
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全差分放大器 2 |
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推荐新设计使用 |
6.0 GHz、超高动态范围、差分放大器 |
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推荐新设计使用 |
具有 10 dB 增益的全差分 10 GHz ADC 驱动器 |
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时钟产生器件 2 |
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最后购买期限 |
具有 11 个输出并支持 JESD204B / JESD204C 协议的超低抖动、4.5GHz PLL |
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推荐新设计使用 |
带JESD204B接口的高性能、3.2 GHz、14路输出抖动衰减器 |
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时钟分配器件 3 |
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推荐新设计使用 |
高性能、3.2 GHz、14输出扇出缓冲器 |
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最后购买期限 |
具有 11 个输出并支持 JESD204B/JESD204C 协议的超低抖动、4.5GHz 时钟分配器 |
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最后购买期限 |
超低抖动 7.5GHz 11 输出扇出缓冲器系列 |
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数字控制VGA 2 |
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推荐新设计使用 |
适用于 RF DAC 和收发器的 500 MHz 至 1000 MHz 发射 VGA |
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推荐新设计使用 |
用于 RF DAC 和收发器的发射 VGA |
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正线性稳压器(LDO) 4 |
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推荐新设计使用 |
5 A、低V IN 、低噪声、CMOS线性稳压器 |
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推荐新设计使用 |
2 A、超低噪声、高PSRR、固定输出、RF线性稳压器 |
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推荐新设计使用 |
6.5 V、2 A、超低噪声、高 PSRR、快速瞬态响应 CMOS LDO
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推荐新设计使用 |
800 m A、超低噪声/高 PSRR LDO |
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JESD204x Frame Mapping Table Generator
Info:False
The JESD204x Frame Mapping Table Generator tool consists of two Windows executables that will allow the user to input any valid combination of JESD204x parameters (L, M, F, S, NP) in order to output a .csv file that illustrates the frame mapping of the JESD204x mode in table format. There is an executable that allows the user to input a single JESD204x mode and another, that allows the user to input the parameters for multiple JESD204x modes in a specified .csv format in order to output a .csv file that illustrates the frame mapping of each of the JESD204x modes that were input into separate tables.
评估套件 4
EVAL-AD9081
AD9081 评估板
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X波段相控阵平台
可扩展32元件混合波束成形相控阵雷达开发平台
ADS9-V2EBZ
ADS9-V2EBZ 评估板
QUAD-MxFE平台
16Tx/16Rx直接L/S/C频段采样相控阵/雷达/电子战/卫星通信开发平台
工具及仿真模型 8
S-参数
文章来源于:analog.com 原文链接
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