AD9261数据手册和产品信息

发布时间:2024-11-11 09:18:10  
AD9261 Functional Block Diagram
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特性
  • SNR:83 dB(85 dBFS,最高10 MHz输入)
  • SFDR:87 dBc(最高10 MHz输入)
  • 噪声系数:15 dB
  • 输入阻抗:1 kΩ
  • 电源:340 mW
  • 1.8 V模拟电源供电
  • 1.8 V至3.3 V输出电源
  • 可选带宽:2.5 MHz/5 MHz/10 MHz
  • 输出数据速率:30 MSPS至160 MSPS
  • 集成抽选滤波器
  • 集成采样速率转换器
  • 片内PLL时钟倍频器
  • 片内基准电压
  • 数据格式:偏移二进制、格雷码或二进制补码
  • 串行控制接口(SPI)
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AD9261是一款16位模数转换器(ADC),采用连续时间Σ-Δ架构,可在10 MHz输入带宽上实现86 dB的动态范围。连续时间Σ-Δ架构所独有的集成功能和特性可大大简化其使用,并将所需的外部原件降至较少。

AD9261具有阻性输入阻抗,可显著降低对驱动器放大器的要求。此外,32倍过采样五阶连续时间环路滤波器可显著衰减带外信号和混叠,因而输入端无需外部滤波器。

外部时钟输入或集成的整数N分频锁相环(PLL)提供过采样连续时间Σ-Δ调制器所需的640 MHz内部时钟。片内抽取滤波器和采样速率转换器可将调制器数据速率从640 MSPS降至用户定义的输出数据速率(30 MSPS至160 MSPS),从而实现更高效、更直接的接口。

数字输出数据格式为偏移二进制、格雷码或二进制补码。数据时钟输出(DCO)用来确保接收逻辑以正确的时序工作。

AD9261采用1.8 V模拟电源和1.8 V至3.3 V数字电源供电,功耗为375 mW。它提供48引脚LFCSP封装,额定温度范围为−40°C至+85°C工业温度范围。

产品聚焦

  1. 连续时间Σ-Δ架构可有效实现高动态范围和宽带宽。
  2. 无源输入结构可降低对驱动器放大器的要求,或者省去驱动器放大器。
  3. 32倍过采样率和高阶环路滤波器可提供出色的混叠抑制性能,降低对抗混叠滤波器的要求,或者省去抗混叠滤波器。
  4. 集成的抽取滤波器、采样速率转换器、PLL时钟乘法器和基准电压源使该器件易于使用。
  5. 采用1.8 V单模拟电源和1.8 V至3.3 V输出电源供电。
  6. 标准串行端口接口(SPI)支持各种产品特性和功能。

应用

  • 数据采集
  • 自动测试设备
  • 仪器仪表
  • 医疗成像
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数据手册 1

应用笔记 10

技术文章 2

评估设计文件 1

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ADI 始终高度重视提供符合最高质量和可靠性水平的产品。我们通过将质量和可靠性检查纳入产品和工艺设计的各个范围以及制造过程来实现这一目标。出货产品的“零缺陷”始终是我们的目标。查看我们的 质量和可靠性计划和认证 以了解更多信息。

产品型号 引脚/封装图-中文版 文档 CAD 符号,脚注和 3D模型
AD9261BCPZ-10 48-Lead LFCSP (7mm x 7mm x 0.85mm w/ EP) external-link
  • HTML
  • Material Declaration external-link
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  • Reliablity Data external-link
AD9261BCPZRL7-10 48-Lead LFCSP (7mm x 7mm x 0.85mm w/ EP) external-link
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产品型号

产品生命周期

PCN

9月 13, 2017

- 16_0077

CANCELLED: Conversion of Select 4x4, 5x5, 6x6 and 7x7mm LFCSP Package Outlines from Punch to Sawn and Transfer of Assembly Site to ASE Korea.

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部分模型 产品周期 描述

串联基准电压源 1

量产

精密串联模式亚带隙基准电压源

单端转差分放大器 2

推荐新设计使用

超低失真差分ADC驱动器(单通道)

推荐新设计使用

低功耗差分ADC驱动器

时钟产生器件 3

推荐新设计使用

1.2 GHz时钟分配IC,PLL内核,分频器,延迟调整,8路输出

推荐新设计使用

1.2 GHz时钟分配IC,PLL内核,分频器,延迟调整,5路输出

推荐新设计使用

1.2 GHz时钟分配IC、2路1.6 GHz输入、分频器、延迟调整、5路输出

时钟分配器件 3

推荐新设计使用

800 MHz时钟分配IC,分频器,延迟调整,三路输出

推荐新设计使用

1.6 GHz时钟分配IC、分频器、延迟调整、3路输出

推荐新设计使用

1.6 GHz时钟分配IC,分频器,延迟调整,两路输出

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评估套件 1

EVAL-AD9261

AD9261 评估板

文章来源于:analog.com    原文链接
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